RISCV

E-Learning: Professionelle Filme und Videos mit dem Smartphone erstellen (E-Learning)

Chief Digital Officer / CDO (m/w/d) Stadt Siegen, Siegen (öffnet im neuen Fenster)

Senior Analog ASIC Design Engineer (m/f/d) Advantest Europe GmbH, Böblingen (öffnet im neuen Fenster)

Clinical Data Scientist (m/w/d) Universitätsmedizin der Johannes Gutenberg-Universität Mainz, Mainz (öffnet im neuen Fenster)

Senior Platform Engineer - Kubernetes (w/m/d) HUK-COBURG Versicherungsgruppe, Coburg (öffnet im neuen Fenster)

Abiturientenprogramm IT: Fachinformatiker Anwendungsentwicklung + Bachelor Professional IT (m/w/d) Schwarz Digits, Neckarsulm (öffnet im neuen Fenster)

CRM / Marketing Automation Spezialist (w/m/d) HUK-COBURG Versicherungsgruppe, Coburg (öffnet im neuen Fenster)

IT-Systemadministrator (m/w/d) - Windows, Active Directory & Microsoft 365 transnova-RUF Verpackungs- und Palettiertechnik GmbH, Ansbach (öffnet im neuen Fenster)

ERP-Consultant (m/w/d) IBC SOLAR AG, Bad Staffelstein (öffnet im neuen Fenster)

Das Mars CM ist kompatibel zum Raspberry Pi 4 CM, das Meles kommt mit leistungsfähigerem SoC. (Bild: Milk-V) (Milk-V)

Wie Compute Module und Pi4: Milk-V bringt RISC-V-Computer im Raspberry-Pi-Format

Ordentliche Leistung, gute Ausstattung, günstiger Preis: Damit werben die neuen SBC von Milk-V. Eines ist zum Raspberry Pi Compute Module kompatibel.

Auf Sifives Roadmap steht schon der Nachfolger für den noch inoffiziellen P870. (Bild: SiFive) (SiFive)

P870: Sifive stellt neuen RISC-V-Hochleistungskern vor

Hot Chips Offiziell gibt es den P870 noch nicht, Sifive hat aber bereits über den neuen RISC-V-Kern gesprochen. Auch eine Variante für die Automobilindustrie wird es geben.

4 Kommentare / Ein Bericht von Johannes Hiltscher

Der SBC Mars von Milk-V soll in Gehäuse für den Raspberry Pi 3 passen. (Bild: Milk-V) (Milk-V)

Milk-V Mars: Der Raspberry Pi mit RISC-V-Prozessor

Gleiches Format wie die beliebten Single-Board-Computer, aber mit RISC-V statt ARM kommen zwei SBCs von Milk-V. Außerdem geplant: Eine Workstation mit 64 Kernen.

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Der KI-Chip von Meta auf einem Evaluationsboard (Bild: Meta) (Meta)

MTIA: Metas Beschleuniger nutzt 128 RISC-V-Kerne

Erste Einblicke in den KI-Beschleuniger von Meta zeigen die gute Leistung und Effizienz, die mit Googles TPU mithalten kann.

Das Visionfive 2 von Starfive (Bild: Johannes Hiltscher / Golem.de) (Johannes Hiltscher / Golem.de)

Linux-SBC: RISC-V-Board Visionfive 2 bekommt UEFI-Support

Einheitlicher Firmware-Support wie auf x86-Maschinen fehlt vielen Entwicklungsboards. Ein RISC-V-Board zeigt, dass es auch anders geht.

Strukturen auf einem von Globalfoundries gefertigten Wafer - hier entsteht auch Occamy. (Bild: Globalfoundries) (Globalfoundries)

Occamy: Europäischer Open-Source-Beschleuniger mit 432 Kernen läuft

Selbst entwickelte Chiplets mit RISC-V-Kernen, eigener Interposer und HBM-Speicher: Europäische Forscher zeigen ihren bislang leistungsfähigsten Chip.

Seminar: Microsoft 365 Administration: virtueller Drei-Tage-Workshop

E-Learning: Systemadministration leicht gemacht - Einsteigerpaket: 5 Kurse im Paket (E-Learning)

Seminar: CustomGPTs zu KI-Assistenten entwickeln: virtueller Ein-Tages-Workshop

Seminar: Microsoft Entra ID (Azure Active Directory): virtueller Ein-Tages-Workshop

Das Pinetab 2 gibt es alternativ auch mit RISC-V-SoC. (Bild: Pine64, Montage: Golem.de) (Pine64, Montage: Golem.de)

Pine64: Pinetab 2 kommt mit RISC-V-Option

Mehr Vielfalt: Das Pinetab 2 wird es auch mit Starfives JH7110 geben. Der Termin für den Verkaufsstart von ARM- und RISC-V-Modell steht fest.

Der erste RISC-V-SBC mit beschleunigter 3D-Grafik: Starfives Visionfive 2 (Bild: Starfive) (Starfive)

Baidu: Starfive will RISC-V ins Rechenzentrum bringen

Dank einer Investition von und Kooperation mit Baidu soll RISC-V fit werden für das Rechenzentrum.

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Das Tinker V verwendet einen RISC-V-Chip. (Bild: Asus) (Asus)

Tinker V: Asus bringt kleinen Einplatinenrechner mit RISC-V

Das Tinker V von Asus hat genug Anschlüsse und Schnittstellen, um bei Bastelprojekten oder im IoT-Bereich auszuhelfen.

In den Ausstellungskoffer hat es der ESP32-H2 mit Zigbee-Funkmodul schon geschafft. (Bild: Johannes Hiltscher, Golem.de) (Johannes Hiltscher, Golem.de)

Zigbee & Matter: Espressif zeigt Mikrocontroller fürs Smart Home

Lange angekündigt, bald verfügbar: Espressifs Chips mit Zigbee-Support. Auch die Controller mit 5-Ghz Wi-Fi sollen bald verfügbar sein.

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Fluttert in die Zukunft: Googles Multiplattform-Open-Source-Framework (Bild: Hari K Patibanda via flickr) (Hari K Patibanda via flickr)

Open Source Framework: Flutter 3.7 mit Webassembly und RISC-V

Auf dem Flutter-Forward-Event gab es den Flutter-3.7-Release. Google gab dazu noch Einblicke in zukünftige Pläne mit dem Framework.

Intel zieht einige Stecker. (Bild: Intel) (Intel)

Sparmaßnahmen bei Intel: Intel stellt Pathfinder und Switches ein und löst AXG auf

Das schlechte Quartalsergebnis von Intel ist ein weiterer Anlass für Sparmaßnahmen: Produkte werden eingestellt und Abteilungen umstrukturiert.

Der PDP 1 war für damalige Zeit ein kompakter Computer. (Bild: Marcin Wichary from San Francisco, Calif., CC BY 2.0, via Wikimedia Commons) (Marcin Wichary from San Francisco, Calif., CC BY 2.0, via Wikimedia Commons)

Podcast Besser Wissen: Wie der PDP 1 die Welt veränderte

Der ZX81 war winzig und hatte lediglich ein KByte Speicher. (Bild: Montage: Golem) (Montage: Golem)

Podcast Besser Wissen: Der 1K-Computer

Die Pfarrkirche St. Peter und Paul in Görlitz. (Bild: Montage: Golem.de) (Montage: Golem.de)

Podcast Besser Wissen: Die digitale Oberlausitz

Links der Commodore C116, in der Bildmitte der Plus/4 (Bild: Martin Wolf/Golem) (Martin Wolf/Golem)

Podcast Besser Wissen: 264 statt C64?

Rauschzustände lassen sich auf vielerlei Art erreichen. (Bild: Montage: Golem) (Montage: Golem)

Podcast Besser Wissen: Techno, Tanzen und Tauchen

Der C64-Laptop stammt zu großen Teilen aus dem 3D-Drucker. (Bild: Martin Wolf/Golem) (Martin Wolf/Golem)

Podcast Besser Wissen: Der C64-Laptop aus dem 3D-Drucker

Bob Brennan von Intel Foundry Services und Partrick Little von Sifive zeigen einen Prototyp der Horse-Creek-Plattform. (Bild: Sifive) (Sifive)

Intel & Sifive: Erstes Horse-Creek-Board mit RISC-V-Chip erscheint im Sommer

Intel will mit RISC-V neue Wege gehen, die Parameter für den ersten Chip stehen - zumindest grob.

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Wie schlägt sich das erste RISC-V-SoC mit 3D-Grafikeinheit gegen den König der Single Board Computer? (Bild: Johannes Hiltscher, Golem.de) (Johannes Hiltscher, Golem.de)

Visionfive 2 im Test: Der erste RISC-V-Prozessor mit 3D-Grafik ist herausfordernd

Eine Alternative zum Raspberry Pi ist der Visionfive 2 derzeit nicht - wer etwas von Linux und Software-Kompilierung versteht, kann aber mit viel Spaß eine neue Plattform ergründen.

32 Kommentare / Ein Test von Johannes Hiltscher,Sebastian Grüner

Tencent setzt auf RISC-V. (Bild: REUTERS) (REUTERS)

China: Tencent will offenbar RISC-V-Chips

Mit den immer größer werdenden Beschränkungen für US-Hardware wendet sich nun auch der chinesische Anbieter Tencent RISC-V-Designs zu.

Im Rechenzentrum sieht Ventana Microsystems noch viel Platz für RISC-V. (Bild: Flickr, RISC-V Foundation / Montage: Golem.de) (Flickr, RISC-V Foundation / Montage: Golem.de)

Ventana Veyron: RISC-V kommt ins Rechenzentrum

Das Start-up Ventana stellt offiziell seine erste CPU für Hyperscaler vor. Ein ungewöhnliches Produktkonzept soll ARM und x86 Konkurrenz machen.

Nvidia sichert seine Hardware strikt ab. (Bild: Reuters) (Reuters)

Embedded Entwicklung: Nvidia ersetzt C mit Ada und Spark für bessere Sicherheit

Die Firmware und Boot-Sequenz auf Nvidia-Karten ist besser abgesichert worden. Dafür wird das anfällige C ersetzt.

Chips von Sifive nutzen RISC-V. (Bild: Sifive) (Sifive)

CPU: Sifive erweitert schnellsten RISC-V-Kern um Vektor-ALU

Der neue RISC-V-Kern P670 von Sifive soll eine vergleichbare Leistung zu ARMs Cortex-A78 haben, aber deutlich weniger Fläche benötigen.

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Android läuft künftig auch offiziell auf RISC-V. (Bild: Tobias Költzsch/Golem.de) (Tobias Költzsch/Golem.de)

CPU: Google nimmt RISC-V-Support offiziell in Android auf

Die Unterstützung für den RISC-V-Befehlssatz wandert in den offiziellen Android-Entwicklungszweig. Der Code stammt mehrheitlich von Alibaba.

Das Ox64 wird bereits in Mengen produziert. (Bild: Pine64) (Pine64)

Pine64 Ox64: Winziges Bastelboard mit RISC-V-CPU kostet unter 10 Dollar

Das Ox64 erinnert an Microcontroller wie das Raspberry Pi Pico - allerdings mit mehr Funktionen. Die RISC-V-CPU funktioniert mit Linux.

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RISC-V: Ubuntu für günstiges RISC-V-Board

Kurznews Was am 20. September 2022 neben den großen Meldungen sonst noch passiert ist, in aller Kürze.

Künftige Weltraummissionen der Nasa sollen RISC-V-Chips verwenden. (Bild: Nasa) (Nasa)

High-Performance Spaceflight Computing: Nasa will mit RISC-V ins All

Die Computer für Weltraumflüge der Nasa sollen künftig RISC-V-Kerne nutzen. Diese sollen 100-fach schneller sein als in bisherigen Rechnern.

Mit RISC-V können Unternehmen sich von einigen Einschränkungen anderer Befehlssätze befreien. (Bild: Pixabay (Monatage: Golem.de)) (Pixabay (Monatage: Golem.de))

RISC-V: Nicht nur frei, sondern sanktionsfrei

Der offene RISC-V-Befehlssatz erfreut sich immer größerer Beliebtheit. Das hat ökonomische Gründe, aber auch Politik spielt eine Rolle.

9 Kommentare / Eine Analyse von Johannes Hiltscher

Speziell der PCIe-Slot macht den Star64 interessant, aber auch die restliche Ausstattung klingt vielversprechend. (Bild: Pine64) (Pine64)

Star64: Erstes RISC-V-Board von Pine64

Nach mehreren ARM-Platinen kündigt Pine64 den ersten Bastelrechner mit RISC-V-Chip an. Interessant: Er verfügt über einen PCIe-Slot.

Mit der Plattform Wujian 600 sollen sich RISC-V-SoCs erstellen lassen. (Bild: Alibaba) (Alibaba)

T-Head: Alibaba erstellt Entwicklungsplattform für RISC-V-SoCs

Mit der Plattform Wujian 600 hat das Unternehmen bereits ein eigenes RISC-V-SoC erstellt. Das sollen nun auch andere können.

RISC-V: Visionfive 2 mit 3D-Grafik kann vorbestellt werden

Starfive hat seinen neuen RISC-V-Chip vorgestellt. Er soll die Leistung von ARM-Kernen erreichen und kann bei Kickstarter vorbestellt werden.

Noch ist der JH7110 nur eine mysteriöse Ankündigung auf der Homepage von Starfive. (Bild: Starfive) (Starfive)

RISC-V: Leistungsfähigere Chips mit 3D-Grafik und Flug ins All

Starfive kündigt RISC-V-SoC mit vier Kernen und 3D-Grafik an, Canonical ein aktuelles Ubuntu. Auch im All kreist eine RISC-V-CPU.

Der Devterm mit dem Core-Modul R-01 auf Basis des Allwinner D1. (Bild: Martin Wolf , Sebastian Grüner / Golem.de) (Martin Wolf , Sebastian Grüner / Golem.de)

Devterm Kit R-01: Mit RISC-V freudig in die Linux-Bastelhölle

Eine günstige RISC-V-Platine zeigt, dass damit die Nachfolge von ARM angetreten werden kann. Bis dahin müssen Bastler aber noch Fehler in Kauf nehmen.

6 Kommentare / Von Sebastian Grüner

Zur RISC-V-Familie könnte bald auch ein Laptop gehören. (Bild: Pixabay) (Pixabay)

CPU: RISC-V-Laptop soll native Entwicklung ermöglichen

Der erste Laptop mit RISC-V soll noch in diesem Jahr verfügbar sein und eine Quadcore-CPU samt 16 GByte RAM bieten.

Micron, RISC-V, WoW: AMD arbeitet an Nachfolger des Steam-Deck-Chips

Kurznews Was am 22. Juni 2022 neben den großen Meldungen sonst noch passiert ist, in aller Kürze.

Aufbau des Neox 3D-Beschleunigers: Bis zu 16 Cluster (links) sind möglich, jedes enthält vier RISC-V-Kerne als Shader (rechts). (Bild: Think Silicon) (Think Silicon)

RISC-V: Freier Befehlssatz als Basis für GPU

Mit dem freien RISC-V-Befehlssatz baut ein Unternehmen 2D- und 3D-Grafikhardware. Die ist leider nicht frei und für sparsame Chips gedacht.

Die RTXM-2200 ist die erste RISC-V-CPU von Imagination der Catapult-Serie. (Bild: Imagination Technologies) (Imagination Technologies)

IMG RTXM-2200: Imgtech bringt erste Echtzeit-CPU auf Basis von RISC-V

Die Embedded-Echtzeit-CPU ist einer der ersten Chips der noch jungen RISC-V-Serie Catapult von Imagination.

Trotz eigens designtem Aufkleber enttäuschend: Monte Cimone, hier ein System mit acht Knoten (Bild: E4 Computer Engineering) (E4 Computer Engineering)

RISC-V: Viele Kerne machen noch keinen Supercomputer

Italienische Forscher haben einen Cluster-Computer mit 32 Risc-V-Kernen zusammengestellt und vermessen. Der Sinn ist fraglich.

3 Kommentare / Von Johannes Hiltscher

Nach dem Konkurs verkauft MIPS wieder Prozessordesigns - allerdings mit RISC-V ISA. (Bild: Wikimedia Commons) (Wikimedia Commons)

RISC-V: MIPS gibt eigene Prozessorarchitektur auf

Nachdem die Bedeutung der eigenen Architektur stetig zurückging, setzt der Prozessorentwickler auf RISC-V.

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Die Prozessoren von Esperanto haben Speicher bekommen, der hier noch fehlt, und können ausprobiert werden. (Bild: Esperanto) (Esperanto)

Esperanto ET-SoC-1: Interessenten können RISC-V-KI-Beschleuniger testen

Mit 1.088 rechnenden Knechten in 34 Grafschaften soll Esperantos Chip besonders effizient inferenzieren. Samsung und andere testen ihn.

Das MQ Pro ist ein kleines Bastelboard mit RISC-V-SoC. (Bild: Mangopi) (Mangopi)

MQ Pro: Mangopis Alternative zum Raspberry Pi Zero hat USB-C

Der MQ Pro ist so klein wie ein Raspberry Pi Zero und ersetzt einige Ports durch modernere Alternativen. Mit dabei: ein RISC-V-Chip.

Gnome, OpenJDK, Nvidia: Java läuft auf RISC-V

Kurznews Was am 24. März 2022 neben den großen Meldungen sonst noch passiert ist, in aller Kürze.

Der Devterm mit RISC-V-Prozessor (Bild: Clockwork) (Clockwork)

Devterm: Clockwork bringt ersten tragbaren RISC-V-Computer

Clockwork bringt eine Version seines Devterm mit RISC-V-Core - und damit wohl den ersten tragbaren Computer mit einem derartigen Chip.

Der Raspberry Pi bekommt keinen Nachfolger mit RISC-V. (Bild: Raspberry Pi Foundation) (Raspberry Pi Foundation)

Offener Befehlssatz: Wenig Hoffnung auf Raspberry Pi mit RISC-V

Mit einem vollständig offen gelegten SoC wäre der Raspberry Pi noch attraktiver. Leider wird daraus vorerst nichts.

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Intel will die Auftragsfertigung für RISC-V-Chips an sich ziehen. (Bild: Amir Cohen/File Photo/Reuters) (Amir Cohen/File Photo/Reuters)

Halbleiterfertigung: Intel investiert massiv in RISC-V

Mit 1 Milliarde US-Dollar will Intel seine Auftragsfertigung stärken. Davon profitiert auch die RISC-V-Community.

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Der EPAC-Testchip für Supercomputer (Bild: EPI) (EPI)

European Processor Initiative: Die erste Phase der HPC-Offensive ist absolviert

Die CPU steht, der Beschleuniger läuft und der Automotive-Chip fährt: Die European Processor Initiative (EP) hat ihre Ziele für 2021 erreicht.

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Baikal BE-S1000X mit 48 Kernen (Bild: Baikal) (Baikal)

Baikal BE-S1000X: Russischer 48-Kern-ARM-Chip läuft

Mit dem Baikal-S gibt es eine HPC/Supercomputer-CPU, für Laptops wurde der Baikal-L entwickelt. Die weitere Roadmap ist ambitioniert.

Die Xiangshan-CPUs sind nach Hügeln in Peking benannt. (Bild: Oriental Image via Reuters Connect) (Oriental Image via Reuters Connect)

CPU: China will neue RISC-V-Chips im Halbjahrestakt

Die RISC-V-CPUs der chinesischen Akademie der Wissenschaften sollen agil erstellt werden. Das Team hofft auf eine Kommerzialisierung.

Imagination baut wieder eigene CPUs - RISC-V macht's möglich. (Bild: Hannah McKay//Reuters) (Hannah McKay//Reuters)

Catapult: Imgtech bringt RISC-V CPU-Serie bis zum 8-Kerner

Imagination bietet wieder eigene CPUs an. Die RISC-V-Serie Catapult soll vom Controller bis zum großen 8-Kerner skalieren.

Das Sipeed LicheeRV misst nur wenige Millimeter. (Bild: Sipeed/Montage: Golem.de) (Sipeed/Montage: Golem.de)

LicheeRV: Bastelrechner mit RISC-V ist kleiner als eine Kreditkarte

Das LicheeRV verwendet den Allwinner D1, der auf der RISC-V basiert. Damit können diverse Bastelprojekte realisiert werden.

In Googles Pixel 6 läuft der Security-Chip Titan M2. (Bild: Google) (Google)

Titan M2: Googles Security-Chip nutzt RISC-V

Im neuen Pixel 6 nutzt Google einige eigene Security-Designs auch in der Hardware. Einer der Chips nutzt das freie RISC-V.

Der neue CPU-Kern soll schnell und effizient sein. (Bild: SiFive) (SiFive)

Offene Befehlssatzarchitektur: SiFive hat den schnellsten RISC-V-Kern

Update Die Performance des noch namenlosen RISC-V-Kerns soll 50 Prozent über der des Vorgängers liegen, zudem gibt es die Option für 16-Core-Cluster.