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Xeon gegen AMDs Epyc

Auf dem Server-Workshop im Juni 2017 hatte Intel noch keinen Zugriff auf Epyc, beziehungsweise wenn, dann wollte der Hersteller das nicht öffentlich kundtun. Also wurde das Thema theoretisch angegangen, wenngleich stellenweise mit sehr präzisen Schätzungen. Bereits der Einstieg sorgte für Schmunzeln: Naples liefere eine inkonsistente Leistung, da die Serverprozessoren aus vier Desktop-Chips zusammengepappt seien (C2Q-Retourkutsche!). Intel sieht sich daher mit seinen nativen 28-Kern-CPUs besser aufgestellt als AMD mit 32 Cores.

  • Xeon SP ohne Fabric (Foto: Marc Sauter/Golem.de)
  • Xeon SP ohne Fabric (Foto: Marc Sauter/Golem.de)
  • 4-Sockel-System mit Xeon SP (Foto: Marc Sauter/Golem.de)
  • Die Modellpalette (Bild: Intel)
  • Aufschlüsselung der Bezeichnungen (Bild: Intel)
  • Die Xeon SP sind in vier Familien eingeteilt. (Bild: Intel)
  • Shot des XCC-Dies (Bild: Intel)
  • Shot des HCC-Dies (Bild: Intel)
  • Die Purley-Plattform ist für Skylake-SP und für Cascade Lake gedacht. (Bild: Intel)
  • Wie gehabt werden bis zu acht Sockel unterstützt. (Bild: Intel)
  • Skylake-SP weist zwei AVX-512-Pipes und zusätzlichen L2-Cache auf. (Bild: Intel)
  • Mit starker AVX-512-Nutzung sinkt der Takt. (Bild: Intel)
  • Dennoch steigen Leistung und Effizienz. (Bild: Intel)
  • Mit AVX-512 wird Training ... (Bild: Intel)
  • ... und Inference beschleunigt. (Bild: Intel)
  • Der L2-Cache wird größer, der L3-Puffer ist nicht mehr inklusiv. (Bild: Intel)
  • Die Latenzen steigen offiziell kaum. (Bild: Intel)
  • Skylake-SP nutzt ein Mesh statt Ringbusse. (Bild: Intel)
  • Die Xeon SP weisen sechs DDR4-Kanäle auf. (Bild: Intel)
  • Einzelne Sockel sind per UPI verbunden. (Bild: Intel)
  • Überblick zum XCC-Die (Bild: Intel)
  • HCC- und LCC-Die (Bild: Intel)
  • Naples? Laut Intel nur vier zusammengepappte Desktop-Chips. (Bild: Intel)
  • AMDs Epyc unterstützt kein AVX-512. (Bild: Intel)
  • Skylake-SP soll bessere Latenzen aufweisen. (Bild: Intel)
  • Insgesamt hat Naples mehr DDR4-Bandbreite und PCIe-Gen3-Lanes. (Bild: Intel)
  • Zwei Xeon SP soll rund 65 Prozent schneller sein als zwei Xeon E5 v4. (Bild: Intel)
  • Vier Xeon SP seien etwa 50 Prozent flotter als vier Xeon E7 v4. (Bild: Intel)
Naples? Laut Intel nur vier zusammengepappte Desktop-Chips. (Bild: Intel)
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Intel führt beispielsweise die geringere Rechenleistung an, da Skylake-SP auch AVX-512 unterstützt. Die Instruktionen sind jedoch schwerlich überall relevant, zumal AMD mit acht Speicherkanälen die nominell höhere Bandbreite aufweist - allerdings aufgeteilt auf zwei pro Die. Intels Hauptargument ist daher die Kommunikation zwischen den vier Chips und die Latenzen innerhalb dieser, da jeder aus zwei CCX (CPU Complex) besteht, sowie die PCIe-Bandbreite. Insgesamt hat Naples aber mehr Lanes (128 statt 96+20) zur Verfügung. Die SMT-Implementierung (Simultaneous Multithreading) von AMD wurde auch kritisiert, das negativ skalierende Java-Beispiel ist aber eher ein Software- denn ein Hardware-Problem. Weitere Messwerte mit einem achtkernigen Xeon SP mit 2,2 GHz gegen einen Ryzen-Octacore lieferte Intel nicht.

Da wir keine eigenen Testsysteme mit Naples oder Xeon SP haben, können wir nur auf die Angaben von AMD und Intel zurückgreifen. Verglichen mit zwei Xeon E5-2699 v4 (je 22 Kerne) soll ein Xeon-SP-System mit zwei Xeon Platinum 8180 (je 28 Kerne) durchschnittlich rund 65 Prozent schneller sein. Vier Xeon Platinum 8180 rechnen laut Hersteller etwa 50 Prozent flotter als vier Xeon E7-8890 v4 (24 Kerne). Die einzelnen Resultate variieren abhängig von der Software, da die weiteren Cores sowie AVX-512 und die beiden zusätzlichen Speicherkanäle nur teils in Leistung umgesetzt werden.

  • Xeon SP ohne Fabric (Foto: Marc Sauter/Golem.de)
  • Xeon SP ohne Fabric (Foto: Marc Sauter/Golem.de)
  • 4-Sockel-System mit Xeon SP (Foto: Marc Sauter/Golem.de)
  • Die Modellpalette (Bild: Intel)
  • Aufschlüsselung der Bezeichnungen (Bild: Intel)
  • Die Xeon SP sind in vier Familien eingeteilt. (Bild: Intel)
  • Shot des XCC-Dies (Bild: Intel)
  • Shot des HCC-Dies (Bild: Intel)
  • Die Purley-Plattform ist für Skylake-SP und für Cascade Lake gedacht. (Bild: Intel)
  • Wie gehabt werden bis zu acht Sockel unterstützt. (Bild: Intel)
  • Skylake-SP weist zwei AVX-512-Pipes und zusätzlichen L2-Cache auf. (Bild: Intel)
  • Mit starker AVX-512-Nutzung sinkt der Takt. (Bild: Intel)
  • Dennoch steigen Leistung und Effizienz. (Bild: Intel)
  • Mit AVX-512 wird Training ... (Bild: Intel)
  • ... und Inference beschleunigt. (Bild: Intel)
  • Der L2-Cache wird größer, der L3-Puffer ist nicht mehr inklusiv. (Bild: Intel)
  • Die Latenzen steigen offiziell kaum. (Bild: Intel)
  • Skylake-SP nutzt ein Mesh statt Ringbusse. (Bild: Intel)
  • Die Xeon SP weisen sechs DDR4-Kanäle auf. (Bild: Intel)
  • Einzelne Sockel sind per UPI verbunden. (Bild: Intel)
  • Überblick zum XCC-Die (Bild: Intel)
  • HCC- und LCC-Die (Bild: Intel)
  • Naples? Laut Intel nur vier zusammengepappte Desktop-Chips. (Bild: Intel)
  • AMDs Epyc unterstützt kein AVX-512. (Bild: Intel)
  • Skylake-SP soll bessere Latenzen aufweisen. (Bild: Intel)
  • Insgesamt hat Naples mehr DDR4-Bandbreite und PCIe-Gen3-Lanes. (Bild: Intel)
  • Zwei Xeon SP soll rund 65 Prozent schneller sein als zwei Xeon E5 v4. (Bild: Intel)
  • Vier Xeon SP seien etwa 50 Prozent flotter als vier Xeon E7 v4. (Bild: Intel)
Zwei Xeon SP soll rund 65 Prozent schneller sein als zwei Xeon E5 v4. (Bild: Intel)

In SPECint_rate_2006base etwa, das kein AVX-512 einsetzt, sieht Intel zwei Xeon Platinum 8180 um 52 Prozent vor zwei Xeon E5-2699 v4. AMDs Werten eines Epyc 7601 (32 Kerne) zufolge liegt der Naples-Chip um 47 Prozent vor zwei Xeon E5-2699 v4. Zumindest diese herausgepickte Messung gibt einen Fingerzeig darauf, dass Intel durchaus wieder Konkurrenz hat. Vielleicht wollte der Hersteller daher anders als sonst vorab keine Preise nennen.

Nachtrag vom 13. Juli 2017, 10:37 Uhr

Mittlerweile hat Intel die Preise für die Xeon SP bekanntgegeben. Das Topmodell kostet 13.000 US-Dollar, generell gibt es kaum mehr Leistung für den gleichen Preis.

Offenlegung: Intel hat die Reisekosten nach Portland für Golem.de übernommen.

 DDR4, PCIe, UPI & VROC
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Sharra 17. Jul 2017

Du warst noch nie in einem Raum, dessen Klimakonzept vom Hausmeister auf der Serviette...

bluedroid 14. Jul 2017

Dann guck Dir mal den Power7 MCM von IBM an: https://www.heise.de/newsticker/meldung/IBM...

Quantium40 13. Jul 2017

Mir fällt da spontan eigentlich nur der SuperMUC in München ein, der mit einer Hei...

plutoniumsulfat 13. Jul 2017

Ach sorry, es war bloß eine Anspielung. Natürlich hat das Relevanz.

colon 12. Jul 2017

Andersherum. Die i7 sind beschnitten Xeons.


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